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中科院第三代香山 RISC-V 開源處理器核研發(fā)啟動,命名“昆明湖”架構(gòu)

2022-08-29 09:41 IT之家
關(guān)鍵詞:RISC-V中科院架構(gòu)

導(dǎo)讀:中國科學(xué)院計算技術(shù)研究所研究員包云崗宣布,開展第三代香山(昆明湖架構(gòu))的聯(lián)合開發(fā)。

IT之家8 月 28 日消息,中國科學(xué)院計算技術(shù)研究所研究員包云崗宣布,2022 年 8 月 24 日,中科院計算所、北京開源芯片研究院、騰訊、阿里、中興通訊、中科創(chuàng)達、奕斯偉、算能等形成了聯(lián)合研發(fā)團隊,開展第三代香山(昆明湖架構(gòu))的聯(lián)合開發(fā)。

香山用湖來命名每一代架構(gòu) —— 第一代架構(gòu)是雁棲湖,第二代架構(gòu)是南湖,第三代架構(gòu)是昆明湖。香山開源社區(qū)稱,第一代“雁棲湖”架構(gòu)已經(jīng)成功流片,實測達到預(yù)期性能,第二代“南湖”架構(gòu)正在持續(xù)迭代優(yōu)化中。

IT之家了解到,香山是一款開源 RISC-V 處理器核,“南湖” 采用中芯國際 14nm 工藝,目標(biāo)頻率是 2GHz,SPECCPU 分值達到 10 分 / GHz,支持雙通道 DDR 內(nèi)存以及 PCIe、USB、HDMI 等更多功能。

據(jù)介紹,“香山”處理器核的開發(fā)的重要決策之一,是選擇了敏捷設(shè)計語言 Chisel,原因是開發(fā)效率遠高于 Verilog,實現(xiàn)相同的功能,Chisel 代碼量僅為 Verilog 的 1/5。